Librerie scritte in Verilog
zbasic
Un sistema ZipCPU essenziale, di base, progettato sia per i test che per la rapida integrazione in nuovi sistemi.
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interpolation
Tecniche di interpolazione digitale applicate all'elaborazione del segnale digitale.
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Verilog_Calculator_Matrix_Multiplication
Questo è un semplice progetto che mostra come moltiplicare due matrici 3x3 in Verilog..
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- Mozilla Public License 2.0
demo-projects
Progetti demo per varie schede Kintex FPGA (di openXC7).
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- BSD 3-clause "New" or "Revised"
Arcade-TMNT_MiSTer
Teenage Mutant Ninja Turtles di Konami per la piattaforma MiSTer FPGA.
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- GNU General Public License v3.0 only
fftdemo
Una dimostrazione che mostra come diversi componenti possono essere composti per costruire uno spettrogramma simulato.
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neorv32-verilog
♻️ Converti il processore NEORV32 in un modulo netlist Verilog semplice sintetizzabile utilizzando GHDL..
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- BSD 3-clause "New" or "Revised"
a2o
Il core A2O era un seguito di A2I, scritto in Verilog e supportava un numero di thread inferiore rispetto ad A2I, ma prestazioni più elevate per thread, utilizzando l'esecuzione fuori ordine (ridenominazione dei registri, stazioni di prenotazione, buffer di completamento) e un negozio coda. Ora è in fase di aggiornamento per conformità e integrazione in progetti aperti. (di OpenPOWERFoundation).
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- GNU General Public License v3.0
FPGA_RealTime_and_Static_Sobel_Edge_Detection
Implementazione pipeline di Sobel Edge Detection sulla telecamera OV7670 e sulle immagini fisse.
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- MIT
jt89
sn76489un core Verilog compatibile, con particolare attenzione all'implementazione FPGA e alla compatibilità Megadrive/Master System.
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- GNU General Public License v3.0 only
gateware
Sottomoduli IP, formattati per una più facile integrazione CI.
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- GNU General Public License v3.0
psram-tang-nano-9k
Un controller PSRAM/HyperRAM open source per Sipeed Tang Nano 9K / Gowin GW1NR-LV9QN88PC6/15 FPGA.
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- Apache License 2.0
FPGA_OV7670_Camera_Interface
Streaming in tempo reale della telecamera OV7670 tramite VGA con risoluzione 640x480 a 30 fps.
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- MIT
RISC-V
Progettazione dell'implementazione del core RV32I in Verilog HDL con estensione Zicsr.
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- MIT
caravel_fulgor_opamp
Test Chip OpAmp per uso generico utilizzando Skywater SKY130 PDK.
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- Apache License 2.0
FusionConverter
File di progettazione per il convertitore open-hardware NeoGeo da MVS ad AES.
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- GNU General Public License v3.0 only