Librerie scritte in VHDL
spi-to-axi-bridge
Un bridge da SPI a AXI4-lite per un facile interfacciamento dei banchi di registri airhdl con qualsiasi microcontrollore.
- 21
- Apache License 2.0
neorv32-riscof
✔️Porta di RISCOF per verificare la compatibilità ISA RISC-V del processore NEORV32..
- 19
- BSD 3-clause "New" or "Revised"
wb_spi_bridge
🌉 Un bridge Wishbone-SPI trasparente che supporta Execute-In-Place (XIP)..
- 19
- BSD 3-clause "New" or "Revised"
karabas-128
Karabas-128. Clone ZX Spectrum 128k, basato su CPLD Altera EPM7128STC100.
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- Do What The F*ck You Want To Public
pocket-cnn
Framework da CNN a FPGA per CNN di piccole dimensioni, scritto in VHDL e Python.
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- Mozilla Public License 2.0
Brutzelkarte_FPGA
Il codice di descrizione dell'FPGA Brutzelkarte in VHDL.
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- GNU General Public License v3.0 only
hVHDL_example_project
Un progetto di esempio che utilizza molte delle idee e delle caratteristiche delle librerie hVHDL come moduli matematici a virgola fissa e mobile e ha script di compilazione per gli FPGA più comuni.
- 12
riscv-debug-dtm
🐛 JTAG debug transport module (DTM) - compatibile con le specifiche di debug RISC-V..
- 12
- BSD 3-clause "New" or "Revised"
hVHDL_fixed_point
Libreria VHDL di funzioni matematiche sintetizzabili ad alto livello di astrazione per funzionalità di moltiplicazione, divisione e sin/cos e trasformazioni da abc a dq.
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- MIT
neorv32-examples
Alcuni esempi di neorv32 per schede Intel FPGA che utilizzano Quartus II e SEGGER Embedded Studio per RISC-V..
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Image-Generator-for-FPGA-Evaluation-Board
Progettazione di un generatore di immagini per rappresentare una scena di strada. Può essere utilizzato come progetto autonomo per il generatore di immagini o come generatore di modelli di test per un circuito di rilevamento corsia.
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- GNU General Public License v3.0
